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職位誘惑: 年終獎金,五險一金,福利好,成長空間大

發(fā)布時間: 2019-11-20發(fā)布

職位描述


 
1. Write Verilog or VHDL coding and simulation (NCsim), verification.
2. Synthesis with RC/ET tool and timing analysis.
3. DFT insertion, verification and test pattern generation.
4. Debug with AE and Analog engineers.
5. Be responsible for the design document and other related documents.
6. Other assigned work.
                                              
職責(zé)
1. 編寫 Verilog或者VHDL代碼或者模擬(NCsim),驗證,綜合.
2. RC/ET工具合成并及時分析.
3. DFT嵌入,驗證及測試圖案信號發(fā)生器.
4. 與應(yīng)用工程師和模擬工程師調(diào)試;
5. 負責(zé)設(shè)計文件及其它的相關(guān)文檔工作
6. 公司安排的其他事項
 

職位發(fā)布者

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7天

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100%

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