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ASIC設(shè)計工程師

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  • 12萬-24萬/年
  • 上海
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  • 工作經(jīng)驗不限
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  • 本科
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  • 全職

職位誘惑: 年終獎金,五險一金,福利好,年底雙薪,天天下午茶,年度旅游,技術(shù)領(lǐng)先,成長空間大,節(jié)日禮物

發(fā)布時間: 2018-01-11發(fā)布

職位描述

工作職責(zé):
本職位主要是芯片數(shù)字電路設(shè)計開發(fā),協(xié)同算法工程師定義系統(tǒng)架構(gòu),RTL實現(xiàn)及驗證。并且參與芯片的各個設(shè)計階段,包括系統(tǒng)分析,時序分析,形式驗證,DFT,F(xiàn)PGA測試以及芯片測試。
職位要求:
1.      碩士及以上學(xué)歷,電子工程,微電子,計算機,通信等相關(guān)專業(yè);
2.      精通 Verilog HDL,有扎實的數(shù)字電路基礎(chǔ)知識,熟悉芯片開發(fā)流程,熟悉常用的仿真綜合等EDA工具;
3.      熟悉C/C++語言,熟悉Perl/shell腳本語言;
4.      英語CET—4級以上,能夠熟練的閱讀英文開發(fā)資料;
5.      具備良好的文檔編寫能力和習(xí)慣,能夠編寫規(guī)范的概要和詳細設(shè)計文檔;
6.      具備良好的溝通與協(xié)調(diào)能力,良好的團隊合作意識,強烈的責(zé)任感及進取精神;
7.      具有以下一項或多項經(jīng)驗者優(yōu)先:
a)      有數(shù)字信號處理,數(shù)字通信,音頻處理,或者外設(shè)(USB,MIPI等)設(shè)計經(jīng)驗;
b)     有低功耗設(shè)計經(jīng)驗。

職位發(fā)布者

鳳列妮

HR

7天

簡歷處理用時

100%

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