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高級(jí)ASIC設(shè)計(jì)工程師

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  • 18萬(wàn)-36萬(wàn)/年
  • 蘇州
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  • 5年以上
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  • 本科
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  • 全職

職位誘惑: 股票期權(quán),年終獎(jiǎng)金,五險(xiǎn)一金,福利好,老板nice,十五薪,年度旅游,技術(shù)領(lǐng)先,成長(zhǎng)空間大,技能培訓(xùn)

發(fā)布時(shí)間: 2019-02-28發(fā)布

職位描述

崗位職責(zé):
1、 參與芯片設(shè)計(jì)立項(xiàng)、Spec定義和芯片架構(gòu)的確定
2、 負(fù)責(zé)RTL模塊和頂層設(shè)計(jì),功能驗(yàn)證,性能優(yōu)化,編寫設(shè)計(jì)報(bào)告
3、 協(xié)同系統(tǒng)工程師、FPGA工程師、數(shù)字IC驗(yàn)證工程師和數(shù)字IC后端工程師
4、 完善芯片設(shè)計(jì)規(guī)范與流程

任職要求:
1、 本科及以上學(xué)歷,扎實(shí)的電子工程/微電子/通信/計(jì)算機(jī)專業(yè)基礎(chǔ)
2、 精通Verilog
3、 精通VCS/NCsim/Questa/ NC-Verilog (至少1種),有fullchip前/后仿經(jīng)驗(yàn)
4、 理解數(shù)字IC設(shè)計(jì)全流程,參與芯片前后端交互,至少掌握DC、RC、formality、STA、PT等技能之一
5、 精通Linux/C/Makefile/Perl/Tcl
6、 熟悉PCIe協(xié)議規(guī)范(加分項(xiàng))
7、 熟悉AMBA/AHB/APB/AXI協(xié)議(加分項(xiàng))
8、 熟悉SoC主流架構(gòu)(加分項(xiàng))
9、 FPGA、數(shù)字驗(yàn)證、數(shù)字后端經(jīng)驗(yàn)(加分項(xiàng))
10、 執(zhí)行力/學(xué)習(xí)/合作/溝通能力
 

職位發(fā)布者

華斯亮

Team Leader/ Tech Leader

7天

簡(jiǎn)歷處理用時(shí)

99%

簡(jiǎn)歷及時(shí)處理率

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