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數(shù)字電路設(shè)計(jì)工程師

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職位誘惑: 五險(xiǎn)一金,成長空間大,交通補(bǔ)助,年終獎(jiǎng)金,技術(shù)領(lǐng)先

發(fā)布時(shí)間: 2022-02-28發(fā)布

職位描述

崗位職責(zé):
1. 參與Flash和MCU產(chǎn)品開發(fā),負(fù)責(zé)數(shù)字邏輯部分設(shè)計(jì)和芯片驗(yàn)證。
2. 領(lǐng)導(dǎo)一個(gè)團(tuán)隊(duì)開發(fā)MCU、SOC芯片等,負(fù)責(zé)設(shè)計(jì)可行性評(píng)估,設(shè)計(jì)周期計(jì)劃和控制
3. 負(fù)責(zé)芯片的設(shè)計(jì)規(guī)格撰寫,系統(tǒng)架構(gòu)設(shè)計(jì),軟硬件劃分
4. 依照設(shè)計(jì)規(guī)格,系統(tǒng)架構(gòu)的需要選擇外部IP, 定義內(nèi)部IP
5. 依照設(shè)計(jì)規(guī)格,系統(tǒng)架構(gòu)的要求完成邏輯模塊設(shè)計(jì),RTL設(shè)計(jì)
6. 撰寫仿真計(jì)劃,指導(dǎo)仿真工作, 提升驗(yàn)證覆蓋率
7. 撰寫原型機(jī)驗(yàn)證計(jì)劃,指導(dǎo)原型機(jī)驗(yàn)證工作, 提升驗(yàn)證覆蓋率。
8. 撰寫樣片驗(yàn)證,測(cè)試計(jì)劃。
9. 根據(jù)仿真計(jì)劃,進(jìn)行數(shù)字或數(shù)?;旌戏抡鏈y(cè)平臺(tái)搭建和優(yōu)化,測(cè)試用例開發(fā)。
10.. 根據(jù)原型機(jī)驗(yàn)證計(jì)劃,實(shí)現(xiàn)FPGA設(shè)計(jì),進(jìn)行原型機(jī)驗(yàn)證平臺(tái)搭建和優(yōu)化,測(cè)試用例開發(fā)。
11.. 負(fù)責(zé)芯片邏輯綜合與DFT/時(shí)序分析,生成測(cè)試向量保證錯(cuò)誤覆蓋率,配合后端工程師完成時(shí)序收斂設(shè)計(jì),優(yōu)化版圖Floorplan。
12.. 輔助樣片驗(yàn)證和測(cè)試,協(xié)助進(jìn)行失效分析
13.. 分析設(shè)計(jì)流程和方法;盡可能實(shí)現(xiàn)統(tǒng)一的、自動(dòng)化的、可重用的,模塊化的設(shè)計(jì)平臺(tái),維護(hù)該平臺(tái)并持續(xù)優(yōu)化。
14.. 訓(xùn)練培訓(xùn)團(tuán)隊(duì)成員技術(shù)能力。

任職資格:
1.微電子等相關(guān)專業(yè),碩士及以上學(xué)歷,5年以上數(shù)字邏輯設(shè)計(jì)與驗(yàn)證經(jīng)驗(yàn);
2.熟悉并掌握Verilog simulation(ncverilog,VCS)和Synthesis tools(DC、PT etc);
3.了解全定制芯片設(shè)計(jì)流程,熟悉cadence的Virtuoso設(shè)計(jì)環(huán)境;
4.具備Flash/SRAM/DRAM等存儲(chǔ)器設(shè)計(jì)和驗(yàn)證經(jīng)驗(yàn)者優(yōu)先。
5.具備扎實(shí)的數(shù)字電路知識(shí),MCU應(yīng)用系統(tǒng)知識(shí),熟悉匯編語言編程。
6.熟悉邏輯設(shè)計(jì),熟悉邏輯綜合及時(shí)序收斂等數(shù)字前端設(shè)計(jì)方法;
7.有較強(qiáng)的腳本(Perl、Tcl、Shell等)編程能力。
8.具備較強(qiáng)的思考問題、分析問題、解決問題的能力和較強(qiáng)的應(yīng)變能力。
9.具有良好的學(xué)習(xí)能力、團(tuán)隊(duì)精神、責(zé)任感、積極主動(dòng)、溝通能力強(qiáng)。
10..深刻理解并執(zhí)行“持續(xù)改進(jìn)”理念者,技術(shù)文檔編寫能力強(qiáng)者尤佳。
11..有以下相關(guān)經(jīng)驗(yàn)優(yōu)先:精通Cortex系列內(nèi)核SOC芯片設(shè)計(jì),掌握7816,USB等通信接口的開發(fā),熟悉UVM驗(yàn)證方法學(xué)、有用SystemVerilog等驗(yàn)證語言進(jìn)行驗(yàn)證的經(jīng)驗(yàn)
12..有過基于ARM Cortex系列內(nèi)核SOC芯片設(shè)計(jì)經(jīng)驗(yàn)者,并有過軟硬件聯(lián)合驗(yàn)證調(diào)試經(jīng)驗(yàn)者優(yōu)先
13..具備很深厚的digital IC開發(fā)背景,有數(shù)模混合IC設(shè)計(jì)開發(fā)經(jīng)歷尤佳;
14..具有FPGA調(diào)試經(jīng)驗(yàn)

職位發(fā)布者

劉茜

其他

7天

簡(jiǎn)歷處理用時(shí)

98%

簡(jiǎn)歷及時(shí)處理率

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