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發(fā)布時(shí)間: 2018-04-24發(fā)布

職位描述

職位描述：
參與NAND Flash存儲(chǔ)控制器系統(tǒng)設(shè)計(jì)，撰寫(xiě)軟硬件要求說(shuō)明，設(shè)計(jì)軟硬件接口
負(fù)責(zé)NAND Flash存儲(chǔ)控制器邏輯部分微構(gòu)架設(shè)計(jì)，模塊需求說(shuō)明，測(cè)試場(chǎng)景說(shuō)明，促使開(kāi)發(fā)團(tuán)隊(duì)達(dá)到設(shè)計(jì)要求
RTL編碼，單元驗(yàn)證，配合ASIC/FPGA后端布線實(shí)線，以及時(shí)序收
負(fù)責(zé)軟硬件聯(lián)合調(diào)試時(shí)，問(wèn)題故障定位，集成開(kāi)發(fā)工作
參與邏輯開(kāi)發(fā)項(xiàng)目管理
應(yīng)聘要求：
電子工程專業(yè)或計(jì)算機(jī)專業(yè)碩士畢業(yè)及以上，并擁有3年以上FPGA/ASIC開(kāi)發(fā)工作經(jīng)驗(yàn)，有扎實(shí)的RTL設(shè)計(jì)能力
良好胡邏輯架構(gòu)設(shè)計(jì)規(guī)劃以及文檔編寫(xiě)能力
豐富軟硬件聯(lián)合設(shè)計(jì)，調(diào)試
良好RTL編碼風(fēng)格，單元驗(yàn)證能力
較好FPGA后端規(guī)劃設(shè)計(jì)能力，最好有良好時(shí)序分析收斂技巧
熟悉TCL等腳本語(yǔ)言有FPGA make file腳本仿真實(shí)現(xiàn)的經(jīng)驗(yàn)
熟悉版本管理控制方法
良好自我發(fā)動(dòng)，自我管理能力

職位發(fā)布者

Hellen Lin

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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