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設(shè)計(jì)(數(shù)字)驗(yàn)證工程師

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  • 30萬(wàn)-39.6萬(wàn)/年
  • 上海
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  • 5年以上
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  • 本科
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  • 全職

職位誘惑: 五險(xiǎn)一金?補(bǔ)充醫(yī)療保險(xiǎn)?補(bǔ)充公積金?員工旅游?交通補(bǔ)貼?股票期權(quán)年終獎(jiǎng)金?通訊補(bǔ)貼?定期體檢?彈性工作

發(fā)布時(shí)間: 2018-04-24發(fā)布

職位描述

職位描述:
1.  負(fù)責(zé)制定高覆蓋率的芯片/模塊驗(yàn)證計(jì)劃
2.  用SystemVerilog以及uVM驗(yàn)證方法學(xué)進(jìn)行模塊以及全芯片的功能驗(yàn)證
3.  利用仿真,F(xiàn)PGA和Emulator進(jìn)行性能分析和驗(yàn)證
4.  執(zhí)行帶時(shí)序的后仿真工作
5.  為芯片測(cè)試工程師提供測(cè)試機(jī)測(cè)試向量
6.  在SOC芯片中利用固件代碼(C語(yǔ)言)進(jìn)行芯片測(cè)試
7.  幫助FPGA工程師搭建并調(diào)試芯片/模塊的FPGA驗(yàn)證環(huán)境
 應(yīng)聘要求:
1.  電子工程專業(yè)或計(jì)算機(jī)專業(yè)本科或碩士畢業(yè),并擁有3年以上IC設(shè)計(jì)/驗(yàn)證經(jīng)驗(yàn)
2.  熟悉IC設(shè)計(jì)流程
3.  熟練掌握Cadence, Synopsys, Mentor邏輯仿真工具
4.  熟練掌握Verilog和System Verilog
5.  對(duì)覆蓋率模型,帶約束的隨機(jī)向量生成等驗(yàn)證方法學(xué)有很好的理解(uVM, VMM, OVM)
6.  有較好的基于SOC的C編程基礎(chǔ)
7.  最好熟悉PCIe,NVMe、DDR和Flash相關(guān)技術(shù)

職位發(fā)布者

Hellen Lin

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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