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意瑞半導(dǎo)體(上海)有限公司

資深模擬電路設(shè)計工程師

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  • 30萬-50萬/年
  • 上海
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  • 3年以上
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  • 本科
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  • 全職

職位誘惑: 年終獎金,福利好,老板nice,年底雙薪,成長空間大

發(fā)布時間: 2021-05-17發(fā)布

職位描述

崗位職責(zé):

  1. 參與產(chǎn)品規(guī)格制定,負(fù)責(zé)模擬電路的設(shè)計,仿真,驗證和審核等,編寫電路文檔。
  2. 領(lǐng)導(dǎo)項目開發(fā),在芯片開發(fā)過程中,協(xié)調(diào)團隊合作。
  3. 利用BiCMOS / BCD/CMOS工藝,設(shè)計模擬電路。
  4. 熟悉集成電路制造過程,有效地設(shè)計電路,保證性能。
  5. 指導(dǎo)版圖工程師實現(xiàn)模擬電路的版圖設(shè)計。
  6. 芯片測試與驗證,配合PE和TE使產(chǎn)品順利進入量產(chǎn)。
  7. 與市場、應(yīng)用等其它部門同事溝通交流,解答部分客戶問題。

任職要求:
  1. 工作3-5年.
  2. 電子相關(guān)專業(yè)(微電子專業(yè)優(yōu)先)本科5年以上,碩士3年以上模擬電路開發(fā)經(jīng)驗,熟悉芯片開發(fā)流程.
  3. 大學(xué)英語6級.
  4. 具有創(chuàng)新思想,良好的溝通技巧.
  5. 技術(shù)能力: a) 具有帶隙、放大器、比較器、模數(shù)/數(shù)模,線性穩(wěn)壓器,傳感器,電機控制等等的模擬集成電路設(shè)計知識;  b)熟悉BCD/ BiCMOS / CMOS工藝和器件物理知識的優(yōu)先;   c)軟件工具,如Cadence Analog Artist/Virtuoso/Silicon Ensemble, Synopsys, SPICE, etc.,d) 有很強的布局知識和寄生元件的認(rèn)識
  6. 良好的主動性、計劃性和組織協(xié)調(diào)能力.
  7. 有汽車級芯片完整流片經(jīng)驗者優(yōu)先.

職位發(fā)布者

意瑞半導(dǎo)體

HR

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簡歷處理用時

100%

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