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時(shí)鐘相關(guān)集成電路設(shè)計(jì)工程師

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  • 35萬(wàn)-45萬(wàn)/年
  • 北京
  • |
  • 1-3年
  • |
  • 碩士
  • |
  • 全職

職位誘惑: 技術(shù)領(lǐng)先,成長(zhǎng)空間大,股票期權(quán),年終獎(jiǎng)金,老板nice

發(fā)布時(shí)間: 2019-12-23發(fā)布

職位描述

1. 負(fù)責(zé)設(shè)計(jì),實(shí)現(xiàn)和驗(yàn)證時(shí)鐘電路模塊(XO,PLL);
2. 負(fù)責(zé)溝通和時(shí)鐘相關(guān)的接口;
3. 負(fù)責(zé)編寫(xiě)電路設(shè)計(jì)相關(guān)文檔(電路設(shè)計(jì),仿真,測(cè)試以及checklist);
 
任職要求:
1. 微電子,電子等相關(guān)專業(yè)碩士及以上學(xué)歷;
2. 具有扎實(shí)的RF/Analog電路設(shè)計(jì)理論基礎(chǔ),熟練模數(shù)混合電路IC設(shè)計(jì)流程;
3. 熟練掌握各種EDA軟件的使用(Spectre/Virtuoso等);
4. 有XO,PLL,VCO相關(guān)電路設(shè)計(jì)、流片、測(cè)試且成功者優(yōu)先考慮。

職位發(fā)布者

劉文冬

Team Leader/ Tech Leader

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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