- 15萬-30萬/年
- 南京
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- 5年以上
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- 本科
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- 全職
職位誘惑: 年終獎金,五險一金,福利好,老板nice,天天下午茶,免費(fèi)班車,技術(shù)領(lǐng)先,年度旅游,成長空間大,通訊津貼,交通補(bǔ)助,節(jié)日禮物,技能培訓(xùn)
發(fā)布時間: 2019-12-09發(fā)布
職位描述
職責(zé)描述：
1.負(fù)責(zé)架構(gòu)方案文檔驗(yàn)證，協(xié)助提升文檔交付質(zhì)量。
2.負(fù)責(zé)交付模塊、系統(tǒng)的測試點(diǎn)輸出、驗(yàn)證方案編寫、環(huán)境搭建、驗(yàn)證收斂。
3.與FPGA原型驗(yàn)證團(tuán)隊配合迭代交付RTL代碼。
4.參與驗(yàn)證公共平臺組件的搭建與調(diào)試，提升團(tuán)隊的驗(yàn)證效率和質(zhì)量。
任職要求：
1.熟悉CDV驗(yàn)證流程，精通system Verilog等驗(yàn)證語言，熟悉UVM驗(yàn)證方法學(xué)。熟練掌握VCS、Verdi等工具。
2.有模塊級或系統(tǒng)級驗(yàn)證的經(jīng)驗(yàn)。精通測試點(diǎn)分解、驗(yàn)證環(huán)境搭建，具備獨(dú)立開發(fā)驗(yàn)證環(huán)境的能力。
3.有成功流片經(jīng)驗(yàn)者的優(yōu)先，熟悉PCIe協(xié)議者優(yōu)先，有深度學(xué)習(xí)背景者優(yōu)先。3年以上工作經(jīng)驗(yàn)者優(yōu)先。
4.具有良好的溝通、協(xié)作能力。
職位發(fā)布者
史春玲
HR
7天
簡歷處理用時
100%
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