- 25萬-37萬/年
- 成都
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- 3年以上
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- 碩士
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- 全職
職位誘惑: 技術(shù)領(lǐng)先,成長空間大,老板nice
發(fā)布時(shí)間: 2019-09-17發(fā)布
職位描述
崗位職責(zé):
1．IP設(shè)計(jì)/驗(yàn)證
2．芯片級系統(tǒng)集成
3．芯片前端流程
4．FPGA驗(yàn)證
任職資格:
1．碩士及以上學(xué)歷，3年以上工作經(jīng)驗(yàn)，熟悉的數(shù)字電路設(shè)計(jì)能力，有復(fù)雜IP設(shè)計(jì)經(jīng)驗(yàn)
2．精通verilog RTL描述語言
3．有基于ARM的SoC項(xiàng)目經(jīng)驗(yàn)的優(yōu)先
4．有接口設(shè)計(jì)經(jīng)驗(yàn)的優(yōu)先
5．對低功耗設(shè)計(jì)有深入理解
6．誠信、有責(zé)任心和團(tuán)隊(duì)合作精神
職位發(fā)布者
黃蕊
HR
7天
簡歷處理用時(shí)
100%
簡歷及時(shí)處理率
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