射頻集成電路設(shè)計工程師
- 25萬-50萬/年
- 上海
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- 工作經(jīng)驗不限
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- 碩士
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- 全職
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發(fā)布時間: 2019-05-17發(fā)布
職位描述
崗位職責:
1 基于CMOS工藝的射頻收發(fā)芯片的電路和系統(tǒng)設(shè)計,制定各模塊性能指標和實現(xiàn)方案;
2 獨立進行射頻電路模塊的設(shè)計,其中包括電路結(jié)構(gòu)的確立、行為級和電路級的仿真、電路的實現(xiàn)和芯片的測試,并指導(dǎo)系統(tǒng)級射頻應(yīng)用。
3根據(jù)規(guī)范設(shè)計射頻集成電路諸如LNA、 Mixer、PLL、 VCO, Filter, VGA,AD DA和PA等
4.根據(jù)系統(tǒng)要求將各個功能模塊集成為SOC系統(tǒng)
5.根據(jù)電路要求指導(dǎo)版圖工程師進行版圖設(shè)計
6根據(jù)設(shè)計結(jié)果完成設(shè)計文檔和測試計劃
7芯片功能模塊和系統(tǒng)測試、性能評估和問題分析
任職要求:
1.微電子學,半導(dǎo)體或相關(guān)專業(yè)碩士及以上學歷
2.有LNA、 Mixer、PLL、VCO、PA, Filter,VGA, AD,DA等模塊的設(shè)計經(jīng)驗優(yōu)先
3.熟練掌握電路原理基礎(chǔ)知識,了解反饋理論及其應(yīng)用
4.能正確分析諸如運放,功放,混頻器等集成單元電路
5.熟練使用Cadence 集成電路設(shè)計環(huán)境
6.會用電路仿真軟件建立正確的仿真測試平臺并正確分析電路仿真結(jié)果
7.良好的團隊合作精神,工作敬業(yè)負責