- 12萬(wàn)-24萬(wàn)/年
- 上海
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- 1-3年
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- 學(xué)歷不限
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- 全職
職位誘惑: 五險(xiǎn)一金,年終獎(jiǎng)金,福利好,年度旅游
發(fā)布時(shí)間: 2018-11-22發(fā)布
職位描述
崗位職責(zé)：
1、負(fù)責(zé)模擬電路模塊的版圖設(shè)計(jì)與驗(yàn)證，例如：DRC/LVS/ERC/ANT/ESD；
2、負(fù)責(zé)子模塊的布局布線，包括匹配、噪聲隔離、高低壓隔離等；
2、與設(shè)計(jì)工程師充分溝通，確保完全理解設(shè)計(jì)對(duì)版圖的要求；
3、相關(guān)文檔的撰寫。
任職要求：
1、微電子、電子類專業(yè)本科以上學(xué)歷，兩年以上工作經(jīng)驗(yàn)；
2、熟悉集成電路CMOS工藝流程以及電路基礎(chǔ)知識(shí)；
3、熟悉版圖基本知識(shí)，對(duì)于寄生，噪聲，器件，高精度匹配等知識(shí)有清晰了解；
4、能熟練使用主流IC版圖設(shè)計(jì)工具，如Virtuso等、版圖驗(yàn)證工具，如Calibre；
5、有PLL/ADC/DAC/BGR等模塊、TOP版圖設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮；
7、具有良好的溝通能力、學(xué)習(xí)能力、分析能力和團(tuán)隊(duì)合作能力；
8、先進(jìn)工藝模擬版圖經(jīng)驗(yàn)者優(yōu)先。
職位發(fā)布者
王瑋玉
HR
7天
簡(jiǎn)歷處理用時(shí)
97%
簡(jiǎn)歷及時(shí)處理率
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