模擬IC版圖設(shè)計(jì)工程師
- 15萬-30萬/年
- 無錫
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- 3年以上
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- 本科
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- 全職
職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,福利好,老板nice,年底雙薪,年度旅游,技術(shù)領(lǐng)先,成長(zhǎng)空間大,通訊津貼,節(jié)日禮物,技能培訓(xùn)
發(fā)布時(shí)間: 2020-12-03發(fā)布
職位描述
崗位職責(zé):
1. 根據(jù)電路原理圖進(jìn)行模擬及混合信號(hào)電路版圖設(shè)計(jì)
2. 與電路設(shè)計(jì)工程師合作,優(yōu)化版圖確保電路性能最優(yōu)化
3. 完成版圖物理驗(yàn)證,包括DRC、LVS、ANT等,完成寄生參數(shù)提取
4. 完成Sign-off流程及檢查,編寫版圖設(shè)計(jì)文檔
任職要求:
1. 電子類相關(guān)專業(yè),本科或本科以上學(xué)歷
2. 3年以上版圖設(shè)計(jì)工作經(jīng)驗(yàn),有實(shí)際tape out經(jīng)驗(yàn)者優(yōu)先
3. 熟悉ESD、Latch Up原理及相應(yīng)的版圖預(yù)防對(duì)策
4. 熟練使用EDA工具進(jìn)行版圖物理驗(yàn)證,深度理解驗(yàn)證文件語法者優(yōu)先
5. 具有良好的學(xué)習(xí)能力、溝通協(xié)調(diào)能力和團(tuán)隊(duì)合作精神
職位發(fā)布者
艾為HR
簡(jiǎn)歷處理用時(shí)
簡(jiǎn)歷及時(shí)處理率
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