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集成電路 版圖設(shè)計工程師

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  • 10萬-20萬/年
  • 杭州
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  • 1-3年
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職位誘惑: 年終獎金,五險一金,老板nice,股票期權(quán),技術(shù)領(lǐng)先,成長空間大

發(fā)布時間: 2020-10-13發(fā)布

職位描述

負(fù)責(zé)模擬電路版圖設(shè)計,包括IP版圖和Top版圖的設(shè)計,驗證和參數(shù)提取。

職位要求:
1.微電子、電子工程相關(guān)專業(yè),本科(及以上)學(xué)歷, 1~4年IC layout經(jīng)驗。
2.熟悉混合信號,模擬電路以及版圖設(shè)計, ESD版圖設(shè)計;
3.熟練使用Virtuoso,使用Calibre進(jìn)行DRC、LVS檢查,PEX提取等;
4.有ADC, RF等模擬模塊版圖設(shè)計經(jīng)驗優(yōu)先考慮;
5.熟悉SKILL/Perl/TCL等編程語言優(yōu)先考慮,熟悉Linux系統(tǒng)優(yōu)先考慮;
6.熟悉 180nm  250nm工藝和設(shè)計規(guī)則優(yōu)先考慮;
7.熟悉 匹配/ESD/latch up/天線效應(yīng) 原理及設(shè)計規(guī)則;
8.熟悉stand cell 設(shè)計,善于壓縮版圖面積優(yōu)先。

職位發(fā)布者

Luna

HR

7天

簡歷處理用時

100%

簡歷及時處理率

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