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Coherent Interconnect設(shè)計(jì)工程師

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  • 40萬(wàn)-56萬(wàn)/年
  • 蘇州
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  • 3年以上
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  • 本科
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  • 全職

職位誘惑: 福利好,技術(shù)領(lǐng)先,成長(zhǎng)空間大,七險(xiǎn)一金

發(fā)布時(shí)間: 2022-11-10發(fā)布

職位描述

崗位職責(zé):
1. 研發(fā)高性能服務(wù)器及其加速卡芯片內(nèi)和芯片間高速互聯(lián)總線
2. 開發(fā)互聯(lián)總線 RTL
3. 與驗(yàn)證團(tuán)隊(duì)協(xié)作驗(yàn)證設(shè)計(jì)正確性
4. 與物理設(shè)計(jì)團(tuán)隊(duì)協(xié)作實(shí)現(xiàn)時(shí)序收斂和功耗優(yōu)化
5. 開發(fā)性能模擬器互聯(lián)總線部分
6. 與其他模塊工程師一起進(jìn)行芯片性能和功耗的評(píng)估及優(yōu)化

任職資格:
1. 計(jì)算機(jī)科學(xué)、計(jì)算機(jī)工程或電子工程等相關(guān)專業(yè)學(xué)位
2. 有以下至少一項(xiàng)經(jīng)驗(yàn)
- 精通邏輯設(shè)計(jì)與Verilog語(yǔ)言
- Cache coherence, Memory Consistency, Power Management等領(lǐng)域知識(shí)
- CPU或互聯(lián)總線性能模擬器開發(fā)和性能評(píng)估經(jīng)驗(yàn)
- 計(jì)算機(jī)體系結(jié)構(gòu)知識(shí)
3. 有工業(yè)界互聯(lián)總線研發(fā)經(jīng)驗(yàn)者優(yōu)先，比如QPI, cHT/cHT+, ACE/CHI等

職位發(fā)布者

孫曉琛

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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