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廈門(mén)凌矽

數(shù)字電路設(shè)計(jì)工程師

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  • 40萬(wàn)-60萬(wàn)/年
  • 廈門(mén)
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  • 1-3年
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職位誘惑: 五險(xiǎn)一金,老板nice,成長(zhǎng)空間大,技術(shù)領(lǐng)先,技能培訓(xùn),股票期權(quán),年終獎(jiǎng)金

發(fā)布時(shí)間: 2023-06-01發(fā)布

職位描述

職責(zé):
1.      確定設(shè)計(jì)需求,編寫(xiě)設(shè)計(jì)文檔并完成代碼實(shí)現(xiàn),完成IP或SOC芯片的數(shù)字邏輯設(shè)計(jì)及驗(yàn)證;
2.      協(xié)助AE完成相應(yīng)的FPGA驗(yàn)證工作;
3.      協(xié)助完成SOC系統(tǒng)驗(yàn)證;
4.      負(fù)責(zé)開(kāi)發(fā)文檔、專利及相關(guān)設(shè)計(jì)文檔的撰寫(xiě);
5.      負(fù)責(zé)產(chǎn)品規(guī)格(數(shù)字部分)制定、編寫(xiě)產(chǎn)品說(shuō)明書(shū);
6.      協(xié)助測(cè)試工程師制定測(cè)試規(guī)范,解決測(cè)試開(kāi)發(fā)中的問(wèn)題。
職位要求:
1.      微電子或電路設(shè)計(jì)等相關(guān)專業(yè),本科或碩士學(xué)歷;
2.      2年以上數(shù)字IC設(shè)計(jì)工作經(jīng)驗(yàn);
3.      熟悉整個(gè)芯片開(kāi)發(fā)設(shè)計(jì)流程,能夠理解芯片架構(gòu);
4.      熟練掌握Verilog、SystemVerilog等語(yǔ)言的編程,有扎實(shí)的數(shù)字電路基礎(chǔ);
5.      熟悉DC、PrimeTime、Verdi或類似功能軟件;
6.      在以下相關(guān)的模塊或接口有一定的工作經(jīng)驗(yàn):ARM CPU、AMBA總線、Flash接口、USB接口、I2C、SPI、UART等;
7.      良好的書(shū)面以及口頭表達(dá)能力。
其他要求:
1.      工作積極主動(dòng)、耐心細(xì)致、認(rèn)真負(fù)責(zé)、遵守職業(yè)道德;
2.      有良好的溝通能力和團(tuán)隊(duì)合作精神;
3.      有較強(qiáng)的自學(xué)能力和自我驅(qū)動(dòng)力;
4.      能與團(tuán)隊(duì)成員通力合作按時(shí)完成工作。

薪水參考:年薪40~60萬(wàn)+股權(quán)激勵(lì) 具體面議
 

職位發(fā)布者

邢總

聯(lián)合創(chuàng)始人/CEO/公司高管

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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