- 25萬-40萬/年
- 北京
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- 3年以上
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- 本科
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- 全職
職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,福利好,老板nice,十五薪,技能培訓(xùn)
發(fā)布時(shí)間: 2019-03-29發(fā)布
職位描述
崗位要求：
1. 根據(jù)算法的matlab或者C模型，實(shí)現(xiàn)RTL結(jié)構(gòu)設(shè)計(jì)和代碼編寫;
2. 時(shí)鐘復(fù)位模塊設(shè)計(jì)，總線模塊設(shè)計(jì)，SOC集成;
3. 協(xié)助FPGA原形驗(yàn)證相關(guān)工作；
4. 協(xié)助產(chǎn)品測(cè)試、調(diào)試和應(yīng)用。
任職要求：
1. 本科以上學(xué)歷，2年以上工作經(jīng)驗(yàn)；
2. 熟悉SOC設(shè)計(jì)及驗(yàn)證流程，掌握Verilog、SystemVerilog、C語言；
3. 熟悉無線通信收發(fā)調(diào)制解調(diào)的原理，熟悉Matlab的使用；
4. 熟悉綜合，STA，F(xiàn)ormal，DFT的流程，熟練掌握相關(guān)工具的使用；
5. 熟悉低功耗設(shè)計(jì)流程和方法，有UPF和MVRC等工具的使用經(jīng)驗(yàn)。
職位發(fā)布者
sophie.zhang
7天
簡歷處理用時(shí)
100%
簡歷及時(shí)處理率
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