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芯片版圖設(shè)計(jì)工程師IC Layout Design Engineer

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  • 10萬(wàn)-18萬(wàn)/年
  • 廈門(mén)
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  • 1-3年
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  • 本科
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  • 全職

職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,老板nice,年底雙薪,成長(zhǎng)空間大,技術(shù)領(lǐng)先,交通補(bǔ)助,節(jié)日禮物,技能培訓(xùn)

發(fā)布時(shí)間: 2021-07-09發(fā)布

職位描述

職位描述:
1.獨(dú)立或協(xié)作完成Mixed Mode項(xiàng)目版圖設(shè)計(jì),包括LNA、MIX、AGC、Filter、ADC、PLL、Bandgap等。 
2.獨(dú)立或協(xié)作完成芯片頂層(TOP)版圖設(shè)計(jì)。 
3.獨(dú)立完成版圖各項(xiàng)驗(yàn)證(LVS/DRC/ERC/ESD/ANT)。 
4.協(xié)助完善負(fù)責(zé)項(xiàng)目執(zhí)行方法、流程,及提高驗(yàn)證可靠性。
5. 使用ChipAnalyzer 軟件提取電路,版圖,對(duì)電路簡(jiǎn)化設(shè)計(jì)。
 
崗位要求:
1. 集成電路版圖設(shè)計(jì)培訓(xùn)證書(shū),本科及以上電氣工程師學(xué)位,包括電子,微電子,半導(dǎo)體,或計(jì)算機(jī)科學(xué);
2. 熟練使用Cadence /Mentor版圖設(shè)計(jì)工具;
3. 熟練使用Calibre/Laker/Assura進(jìn)行DRC/LVS / PEX版圖流程;
4. 熟悉CMOS模擬集成電路版圖設(shè)計(jì)相關(guān)知識(shí);
5. 良好的組織能力和解決問(wèn)題的能力;
6. 熟悉TCL 或Skill 更佳

薪酬福利:
★薪酬:薪酬從優(yōu);年薪10萬(wàn)以上。
★假期完整:國(guó)家法定節(jié)假日,帶薪年休假、婚假、產(chǎn)假等;
★福利體系:養(yǎng)老保險(xiǎn)、失業(yè)保險(xiǎn)、工傷保險(xiǎn)、生育保險(xiǎn)、醫(yī)療保險(xiǎn);

工作地點(diǎn):廈門(mén)

職位發(fā)布者

鄭小姐

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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