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IC設(shè)計(jì)工程師

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發(fā)布時(shí)間: 2022-02-23發(fā)布

職位描述

崗位職責(zé):
1. 理解算法，分析芯片設(shè)計(jì)需求，定義模塊微架構(gòu)，撰寫設(shè)計(jì)文檔。
2. 完成數(shù)字芯片前端RTL設(shè)計(jì)，滿足功能和性能要求。
3. 完成模塊仿真。參與、協(xié)助系統(tǒng)級(jí)驗(yàn)證。
4. 協(xié)助生成模塊級(jí)時(shí)序約束，分析時(shí)序結(jié)果，優(yōu)化時(shí)序。
5. 模塊級(jí)功耗分析和功耗優(yōu)化。
6. 協(xié)助FPGA平臺(tái)和硅片平臺(tái)的調(diào)試工作。

職位要求：
1. 本科以上學(xué)歷，電子，信息和計(jì)算機(jī)等相關(guān)專業(yè)畢業(yè)。
2. 芯片設(shè)計(jì)領(lǐng)域2年以上的工作經(jīng)驗(yàn)。
3. 熟悉常用EDA工具如VCS，ncverilog， verdi， DC， spyglass等。
4. 具備優(yōu)秀的verilog編程能力。
5. 熟悉驗(yàn)證方法學(xué)，有較強(qiáng)的debug能力。
6. 熟悉時(shí)序分析，有跨時(shí)鐘域設(shè)計(jì)經(jīng)驗(yàn)。
7. 有以下領(lǐng)域經(jīng)驗(yàn)之一者優(yōu)先：
A. 熟悉AMBA總線
B. 熟悉深度學(xué)習(xí)算法和ASIC實(shí)現(xiàn)
C. 有ISP設(shè)計(jì)經(jīng)驗(yàn)
D. 有CPU/DSP/GPU/AI設(shè)計(jì)經(jīng)驗(yàn)

職位發(fā)布者

王先生

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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