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數(shù)字設(shè)計(jì)工程師（薪資面議）

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  • 3萬-5萬/年
  • 北京
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  • 應(yīng)屆生/在校生
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職位誘惑: 五險(xiǎn)一金，補(bǔ)充醫(yī)療，節(jié)日福利，定期體檢，績效獎(jiǎng)金等

發(fā)布時(shí)間: 2019-09-23發(fā)布

職位描述

崗位職責(zé)：
1. 定義模塊級設(shè)計(jì)需求，完成設(shè)計(jì)文檔，并且用Verilog語言實(shí)現(xiàn)；
2. 對接驗(yàn)證工程師確定驗(yàn)證策略及驗(yàn)證case，完成功能驗(yàn)證；
3. 能完成代碼覆蓋率的分析，以及模塊在芯片內(nèi)的集成；
4. 完成模塊綜合以及靜態(tài)時(shí)序分析。

任職條件：
1. 微電子、電子科學(xué)與技術(shù)、計(jì)算機(jī)、通信、電氣等相關(guān)專業(yè)碩士及以上學(xué)歷;
2. 熟悉Verilog/SystemVerilog/C/C++；
3. 熟悉VMM/UVM驗(yàn)證方法學(xué)；
4. 熟悉tcl，shell，perl，python等腳本；
5. 熟悉芯片設(shè)計(jì)從RTL到GDS的流程，熟悉綜合、STA等概念，熟悉部分芯片實(shí)現(xiàn)工具（DC/PT/ICC等）的使用，有較好的數(shù)字電路基礎(chǔ)；
6. 熟悉FPGA開發(fā)，了解芯片的FPGA原型實(shí)現(xiàn)流程；
7. 了解芯片各模擬模塊的基本工作原理，包括AMP、Bandgap、LDO等，有設(shè)計(jì)經(jīng)驗(yàn)的優(yōu)先；
8. 熟悉SoC芯片設(shè)計(jì)，熟悉ARM、RISC-V等CPU架構(gòu)、熟悉AMBA系列總線協(xié)議，熟悉DDR/USB/MIPI等常用IP特性；
9. 有AI人臉識(shí)別/語音識(shí)別、圖像處理、3D檢測、視頻編解碼相關(guān)項(xiàng)目經(jīng)驗(yàn)優(yōu)先。

職位發(fā)布者

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HR

7天

簡歷處理用時(shí)

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規(guī)模: 500-1000人

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工作地址:

北京

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