- 15萬(wàn)-25萬(wàn)/年
- 成都
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- 3年以上
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- 本科
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- 全職
職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,福利好,老板nice,技能培訓(xùn),成長(zhǎng)空間大
發(fā)布時(shí)間: 2021-12-22發(fā)布
職位描述
職責(zé)描述：
1、開(kāi)發(fā)驗(yàn)證平臺(tái)Verilog/System Verilog，UVM等語(yǔ)言、工具，實(shí)現(xiàn)高效率的芯片功能驗(yàn)證，完成驗(yàn)證執(zhí)行和Debug,滿足Tape out 需求；
2、與IC設(shè)計(jì)工程師密切合作，負(fù)責(zé)IC設(shè)計(jì)項(xiàng)目相關(guān)驗(yàn)證計(jì)劃的制定，驗(yàn)證結(jié)果的評(píng)審，并根據(jù)項(xiàng)目的特點(diǎn)制定不同的驗(yàn)證策略、方案；
任職資格：
1、本科及以上學(xué)歷，電子、通信、計(jì)算機(jī)、半導(dǎo)體物理或微電子專業(yè)；
2、三年以上IP或SOC驗(yàn)證經(jīng)驗(yàn)；
3、具有扎實(shí)IC驗(yàn)證基礎(chǔ)，熟悉IC設(shè)計(jì)驗(yàn)證環(huán)境、流程，撐VCS等相關(guān)驗(yàn)證工具；
4、了解腳本語(yǔ)言使用，如tcl/perl/python等；
5、有良好的溝通能力，協(xié)調(diào)能力及團(tuán)隊(duì)合作意識(shí)。
職位發(fā)布者
石先生
HR
7天
簡(jiǎn)歷處理用時(shí)
100%
簡(jiǎn)歷及時(shí)處理率
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