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IC 版圖設(shè)計(jì)工程師

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  • 20萬(wàn)-40萬(wàn)/年
  • 上海
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  • 1-3年
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  • 全職

職位誘惑: 績(jī)效獎(jiǎng)金,年底雙薪,帶薪年假,彈性工作,年度旅游,定期體檢,五險(xiǎn)一金,補(bǔ)充公積金,團(tuán)隊(duì)聚餐,節(jié)日禮物

發(fā)布時(shí)間: 2020-02-23發(fā)布

職位描述

崗位職責(zé):
1、負(fù)責(zé)模擬/數(shù)模混合電路的版圖設(shè)計(jì)、版圖驗(yàn)證,tapeout;
2、與電路設(shè)計(jì)工程師合作,優(yōu)化版圖確保電路性能最優(yōu)化;
3、完成 Sign-off 流程及檢查,編寫(xiě)版圖設(shè)計(jì)文檔。
任職資格:
1、微電子、電子類(lèi)相關(guān)專(zhuān)業(yè),本科及以上學(xué)歷;
2、3 年以上相關(guān)工作經(jīng)驗(yàn);
3、熟練使用版圖設(shè)計(jì)工具;
4、會(huì)修改工藝文件;
5、熟悉集成電路 CMOS 工藝流程,有 floorplan 經(jīng)驗(yàn);
6、熟悉版圖基本知識(shí),對(duì)于寄生,噪聲,器件,高精度匹配等知識(shí)有清晰了解;
7、理解工藝的特征,包括:latch-up、ESD、器件匹配、shielding、seal ring、electromigration、metal fill 等;
8、熟悉 Skill 腳本和 Pcell;
9、熟悉至少一個(gè)腳本語(yǔ)言:Python、Perl、Ruby。

加分項(xiàng):
1、有 PA / LNA / PLL / ADC / DAC / VCO / TDC / phase interpolator / DCDC 等模塊經(jīng)驗(yàn)者優(yōu)先考慮;
2、有 RF 及物聯(lián)網(wǎng)方面硬件開(kāi)發(fā)設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先。

個(gè)性特質(zhì):
1、具有良好的溝通能力、學(xué)習(xí)能力、分析能力和團(tuán)隊(duì)合作能力;
2、良好的團(tuán)隊(duì)合作和服務(wù)意識(shí)、誠(chéng)信正直;
3、個(gè)性開(kāi)朗、樂(lè)觀、善于表達(dá)。

職位發(fā)布者

Grace Huo

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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