ISP IP FPGA Engineer
- 30萬-60萬/年
- 上海
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- 3年以上
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- 本科
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- 全職
職位誘惑: 年終獎金,五險一金,福利好,老板nice,年底雙薪,股票期權(quán),天天下午茶,技術(shù)領(lǐng)先,成長空間大,交通補助,節(jié)日禮物,技能培訓(xùn)
發(fā)布時間: 2020-05-09發(fā)布
職位描述
工作描述:
此崗位主要負責(zé)ISP IP基于FPGA平臺的軟件驗證和支持客戶FPGA/ASIC平臺軟件測試。
職責(zé):
1. ISP IP模塊功能級別驗證。
2. ISP IP在FPGA平臺上的帶camera sensor的系統(tǒng)級別驗證。
3. 負責(zé)制定測試方案、提取驗證需求、搭建驗證環(huán)境和編寫測試用例。
4. 與IP 設(shè)計人員、驅(qū)動開發(fā)人員溝通與合作完成驗證與支持。
5. 支持客戶FPGA/ASIC平臺上的ISP IP驗證與軟件測試。
要求:
1. 電子、通信、計算機等相關(guān)專業(yè)的大學(xué)本科及以上學(xué)位, 3年以上工作經(jīng)驗。
2. 英語口語流利,熟練掌握C/C++編程語言。
3. 熟悉驗證流程,有回歸調(diào)試、覆蓋分析經(jīng)驗。
4. 良好的調(diào)試和分析能力。
5. 有良好的溝通技巧和團隊合作精神,能夠適應(yīng)跨團隊協(xié)作和客戶支持。
6. 樂觀向上,工作責(zé)任感強、有一定的抗壓能力。
具有下列某些經(jīng)驗者更佳:
1. 圖像和視頻背景或者從業(yè)經(jīng)驗。
2. 有OV、Sony等Camera sensor調(diào)試經(jīng)驗。
3. 熟悉DVP、MIPI、LVDS等硬件接口。
4. 熟悉ARM處理器、DDR AXI總線協(xié)議、DMA等硬件架構(gòu)。
5. 熟悉ISP pipeline和各模塊功能。
6. 有Linux和RTOS、嵌入式開發(fā)經(jīng)驗。
職位發(fā)布者
芯原微
HR
簡歷處理用時
簡歷及時處理率
芯原
領(lǐng)域: 移動手持,消費電子,智能硬件
規(guī)模: 500-1000人
主頁: http://www.verisilicon.com
工作地址:
上海市浦東新區(qū)張江大廈
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