- 30萬-45萬/年
- 成都
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- 5年以上
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- 本科
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- 全職
職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,年底雙薪,技術(shù)領(lǐng)先,成長(zhǎng)空間大
發(fā)布時(shí)間: 2020-03-23發(fā)布
職位描述
崗位職責(zé)：
1、負(fù)責(zé)系統(tǒng)數(shù)字架構(gòu)設(shè)計(jì)、Verilog程序編寫、仿真、驗(yàn)證、綜合；
2、DFT設(shè)計(jì)；
3、配合后端進(jìn)行布局布線和后仿。
崗位要求：
1、5年及以上相關(guān)工作經(jīng)驗(yàn)；
2、有成功流片經(jīng)驗(yàn)；
3、熟悉verilog設(shè)計(jì)方法，熟悉MCU設(shè)計(jì)和FPGA設(shè)計(jì)。
職位發(fā)布者
鄭女士
HR
7天
簡(jiǎn)歷處理用時(shí)
100%
簡(jiǎn)歷及時(shí)處理率
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