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電科申泰

SOC高級(jí)后端工程師

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  • 30萬(wàn)-60萬(wàn)/年
  • 北京
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  • 5年以上
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  • 碩士
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  • 全職

職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,福利好,技術(shù)領(lǐng)先,成長(zhǎng)空間大

發(fā)布時(shí)間: 2020-08-22發(fā)布

職位描述

[崗位職責(zé)]
1、負(fù)責(zé)芯片從Netlist到GDS輸出的后端設(shè)計(jì)工作
2、工作經(jīng)驗(yàn)八年以上(含八年)
3、Floor plan,IO plan,power plan
4、P&R 流程,Place,時(shí)鐘樹(shù)生成,布線,時(shí)序分析與修正
5、功耗分析,信號(hào)完整性分析
6、GDS輸出與驗(yàn)證,DFM分析,寄生參數(shù)提取

[任職要求]
1、熟悉布局布線、物理驗(yàn)證、靜態(tài)時(shí)序分析、功耗分析,DFM分析,寄生參數(shù)提取等物理設(shè)計(jì)流程。
2、具備如下一至多項(xiàng)專業(yè)技能者優(yōu)先: 
a) 具有高速/低功耗電路后端設(shè)計(jì)經(jīng)驗(yàn); 
b) 具有40nm及以下工藝流片經(jīng)驗(yàn); 
c) 熟悉邏輯綜合、DFT、STA等ASIC流程實(shí)現(xiàn)方法;
3、熟練使用UNIX/LINUX操作系統(tǒng),具備較好的TCL/Shell腳本編程能力。
4、良好的團(tuán)隊(duì)精神,為人正直,工作態(tài)度端正,責(zé)任心強(qiáng)。
5、熟悉IC CompilerII/Innovus/Calibre等物理設(shè)計(jì)工具的使用。
6.、碩士(含)以上學(xué)歷。

職位發(fā)布者

何麗麗

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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