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華夏芯

IC設(shè)計(jì)工程師

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  • 25萬-50萬/年
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職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,年度旅游,技術(shù)領(lǐng)先,節(jié)日禮物

發(fā)布時(shí)間: 2020-09-03發(fā)布

職位描述

崗位職責(zé):
1.      參與復(fù)雜IP如AI加速器以及異構(gòu)SOC的架構(gòu)定義,制定功能設(shè)計(jì)規(guī)范;
2.      算法理解和模塊級(jí)RTL設(shè)計(jì)、仿真驗(yàn)證及綜合;
3.      SOC的集成和仿真;
4.      參與FPGA驗(yàn)證。
 
任職要求:
1.      本科從事IC設(shè)計(jì)3年以上,碩士從事IC設(shè)計(jì)1年以上,我們將根據(jù)求職者經(jīng)驗(yàn)和能力提供高級(jí)或初級(jí)職位;
2.      熟悉Verilog/VHDL語(yǔ)言,熟練使用熟練使用Synopsys或Cadence仿真工具;
3.      從事過復(fù)雜IP設(shè)計(jì)或者有SOC集成經(jīng)驗(yàn);
4.      熟悉SystemVerilog及UVM驗(yàn)證方法者優(yōu)先;
5.      熟悉綜合、時(shí)序分析、形式驗(yàn)證等流程者優(yōu)先
6.      有深亞微米流片經(jīng)驗(yàn);
7.      學(xué)習(xí)能力強(qiáng),有責(zé)任心,積極主動(dòng)、溝通能力強(qiáng),有團(tuán)隊(duì)精神。

職位發(fā)布者

閔女士

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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