- 30萬-50萬/年
- 北京
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- 1-3年
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- 本科
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- 全職
職位誘惑: 五險(xiǎn)一金,股票期權(quán),技術(shù)領(lǐng)先,成長空間大
發(fā)布時(shí)間: 2021-02-22發(fā)布
職位描述
- 參與ASIC的架構(gòu)設(shè)計(jì)、模塊劃分和性能優(yōu)化工作；
- 負(fù)責(zé)ASIC的模塊和全芯片物理綜合；
- 負(fù)責(zé)SDC的撰寫；
- 負(fù)責(zé)芯片的靜態(tài)時(shí)序分析、形式驗(yàn)證和功耗分析 ；
- 負(fù)責(zé)Methodology flow的完善和開發(fā)；
- 負(fù)責(zé)編寫相關(guān)設(shè)計(jì)文檔。
- 電子工程類和微電子類相關(guān)專業(yè)；
- 熟悉Verilog語言，有邏輯設(shè)計(jì)，RTL編碼，驗(yàn)證等經(jīng)驗(yàn)，精通者更佳；
- 熟悉Design Compiler, Formality, PrimeTime等EDA工具；
- 豐富的 SDC 撰寫及調(diào)試經(jīng)驗(yàn)；
- 熟悉Linux環(huán)境，熟悉perl、python、shell、TCL語言等；
- 具有芯片成功流片經(jīng)驗(yàn)者優(yōu)先；
- 具備較強(qiáng)的溝通能力和團(tuán)隊(duì)合作意識(shí)。
職位發(fā)布者
劉明
聯(lián)合創(chuàng)始人／CEO／公司高管
7天
簡歷處理用時(shí)
100%
簡歷及時(shí)處理率
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