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模擬電路設(shè)計(jì)技術(shù)專家/資深工程師

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  • 30萬-60萬/年
  • 上海
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  • 3年以上
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職位誘惑: 五險(xiǎn)一金,成長(zhǎng)空間大,福利好,技能培訓(xùn)

發(fā)布時(shí)間: 2021-11-18發(fā)布

職位描述

崗位職責(zé):
1、根據(jù)系統(tǒng)需求制定模擬IP的設(shè)計(jì)規(guī)格與方案,按照業(yè)界標(biāo)準(zhǔn)進(jìn)行IP標(biāo)準(zhǔn)化建設(shè)。
2、按照要求進(jìn)行模擬IP的電路設(shè)計(jì)、仿真驗(yàn)證等工作。
3、指導(dǎo)版圖設(shè)計(jì)工程師完成模擬版圖設(shè)計(jì)。
4、協(xié)助芯片測(cè)試工程師制定測(cè)試方案,完成模擬IP測(cè)試。
任職要求:
1、微電子/通信/計(jì)算機(jī)等相關(guān)專業(yè),本科及以上學(xué)歷。
2、扎實(shí)的模擬電路知識(shí),熟悉集成電路設(shè)計(jì)流程并對(duì)工藝以及測(cè)試具有一定的認(rèn)知。
3、3年以上模擬IC設(shè)計(jì)經(jīng)驗(yàn),至少擁有2款芯片的成功tapeout經(jīng)驗(yàn)。有ADC/DAC/LDO/PLL/POR等設(shè)計(jì)經(jīng)驗(yàn)優(yōu)先。有數(shù)?;旌霞呻娐烽_發(fā)經(jīng)驗(yàn)更佳。
4、精通模擬IC設(shè)計(jì)流程及規(guī)范;熟悉常用模擬集成電路EDA設(shè)計(jì)仿真工具,如spectra、ams、HSpice、Virtuoso、Matlab等,有能力指導(dǎo)版圖設(shè)計(jì)師工作。
5、熟練使用Verilog或Verilog-A語(yǔ)言對(duì)模擬電路進(jìn)行行為級(jí)建模和仿真。
6、有能力指導(dǎo)芯片相關(guān)模擬測(cè)試評(píng)價(jià)及debug。
7、具有良好的團(tuán)隊(duì)精神和溝通技巧。
8、具有嚴(yán)謹(jǐn)務(wù)實(shí)的科學(xué)作風(fēng)和優(yōu)秀的質(zhì)量/成本意識(shí)。
9、具有良好的職業(yè)道德操守和敬業(yè)精神,遵守國(guó)家法律及企業(yè)相關(guān)政策規(guī)定。

職位發(fā)布者

呂鍵

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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