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數(shù)字電路設(shè)計(jì)工程師

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  • 20萬-35萬/年
  • 上海
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  • 3年以上
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  • 本科
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  • 全職

職位誘惑: 年終獎金,五險(xiǎn)一金,福利好,老板nice,十五薪

發(fā)布時(shí)間: 2022-03-22發(fā)布

職位描述

職責(zé)描述：
1.相關(guān)專業(yè)本科以上學(xué)歷，碩士優(yōu)先；2年以上數(shù)字電路設(shè)計(jì)相關(guān)工作經(jīng)驗(yàn)。
2.精通 Verilig、SystemVerilog 等語言
3.熟悉 SOC 架構(gòu)、外設(shè)及 AHB 總線或者有通信基帶芯片設(shè)計(jì)經(jīng)驗(yàn)
4.具備良好的溝通協(xié)調(diào)能力和團(tuán)隊(duì)合作精神，有較強(qiáng)的責(zé)任心和進(jìn)取心，具有很強(qiáng)的獨(dú)立工作能力及動手 能力
5.熟練掌握仿真工具, 熟悉綜合、STA、Formality 等前端設(shè)計(jì)相關(guān)流程，有低功耗設(shè)計(jì)經(jīng)驗(yàn)更佳
6.熟悉 Shell/Tcl/Perl/Python 等腳本語言更佳 有 FPGA 原型驗(yàn)證經(jīng)驗(yàn)更佳
任職要求：
1.從事通信基帶處理器模塊設(shè)計(jì)和系統(tǒng)集成并撰寫設(shè)計(jì)文檔
2.參與 SOC 芯片架構(gòu)設(shè)計(jì)，設(shè)計(jì)相關(guān) IP 和 SOC 集成
3.參與完成芯片模塊和頂層前端實(shí)現(xiàn)流程
4.協(xié)同完成模塊和系統(tǒng)驗(yàn)證 協(xié)助 FPGA 原型驗(yàn)證相關(guān)工作

職位發(fā)布者

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領(lǐng)域: 移動手持,智能硬件,通信網(wǎng)絡(luò)

規(guī)模: 50-100人

主頁: http://vertexventures.cn/cn/

工作地址:

張江

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