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發(fā)布時(shí)間: 2022-09-05發(fā)布

職位描述

崗位職責(zé)：
1.負(fù)責(zé)數(shù)字IP的微架構(gòu)定義及設(shè)計(jì)；
2.負(fù)責(zé)自研和第三方授權(quán)許可的IP。

崗位要求:
1.微電子, 電子工程，自動(dòng)控制，計(jì)算機(jī)碩士等相關(guān)專業(yè),扎實(shí)的數(shù)字電路基礎(chǔ)；
2.熟悉verilog/system verilog等硬件描述語言；
3.有高速接口（e.g. DDR, USB, PCIE, MIPI等）經(jīng)驗(yàn)者優(yōu)先；
4.熟練AMBA bus者優(yōu)先；
5.了解synthesis, STA等設(shè)計(jì)flow者優(yōu)先；
6.良好的英語聽說讀寫能力，團(tuán)隊(duì)合作及創(chuàng)新精神；

職位發(fā)布者

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HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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