- 40萬-60萬/年
- 上海
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- 1-3年
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- 本科
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- 全職
職位誘惑: 年終獎金,五險(xiǎn)一金,福利好,老板nice,成長空間大,技術(shù)領(lǐng)先,技能培訓(xùn),節(jié)日禮物
發(fā)布時間: 2022-11-10發(fā)布
職位描述
職責(zé)描述：
1.模塊設(shè)計(jì)：負(fù)責(zé)模擬混合信號產(chǎn)品中的數(shù)字
2.參與產(chǎn)品數(shù)字部分的spec定義和可行性評估
3.項(xiàng)目跟進(jìn)：負(fù)責(zé)系統(tǒng)建模，數(shù)字電路設(shè)計(jì)實(shí)現(xiàn)，按時高質(zhì)量的完成設(shè)定的項(xiàng)目
4.負(fù)責(zé)撰寫相關(guān)的設(shè)計(jì)技術(shù)文檔及專利
5.與模擬工程師配合，完成數(shù)字/模擬接口部分的設(shè)計(jì)工作
6.協(xié)助解決產(chǎn)品量產(chǎn)過程中出現(xiàn)的問題和相關(guān)的客戶支持工作
7.產(chǎn)品從開發(fā)到發(fā)布過程中，與其他部門緊密配合
任職要求：
1.電子/微電子/通信/計(jì)算機(jī)相關(guān)專業(yè)，本科及碩士以上學(xué)歷；良好的數(shù)字IC設(shè)計(jì)/驗(yàn)證相關(guān)知識儲備；
2.熟悉信號鏈數(shù)模混合電路設(shè)計(jì)與驗(yàn)證，了解系統(tǒng)設(shè)計(jì)與算法設(shè)計(jì);
1、 ASIC或SOC通訊方向尤佳，其他方向也可嘗試.
2、 熟練掌握VHDL或者Verilog語言，具有優(yōu)良的RTL代碼風(fēng)格。掌握高速數(shù)字邏輯的設(shè)計(jì)技巧
3、 熟練使用Spyglass/CDC/Verdi/IES等EDA工具。
4、 熟悉 DC，STA，F(xiàn)ormal Check；
5、 熟悉高性能車規(guī)芯片的數(shù)字設(shè)計(jì)與開發(fā)，包括MCU芯片設(shè)計(jì)以及LIN/CAN總線接口等，基準(zhǔn)源和AD/DA等；（加分）
職位發(fā)布者
陳鑫昌
HR
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